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高速PCB設計中什么時候需要阻抗匹配

  • 發表時間:2019-06-12 15:43:09
  • 作者:下單文員
  • 來源:新聞中心
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  • 本文有559個文字,預計閱讀時間2分鐘

  阻抗匹配是指在能量傳輸時,要求負載阻抗要和傳輸線的特征阻抗相等,此時的傳輸不會產生反射,這表明所有能量都被負載吸收了。反之則在傳輸中有能量損失。在高速PCB設計中,阻抗的匹配與否關系到信號的質量優劣。
高速PCB設計中什么時候需要阻抗匹配

  高速PCB設計中的阻抗匹配

  不(bu)主要(yao)看頻率,而關鍵是(shi)看信號(hao)的(de)邊沿陡峭程度,即(ji)信號(hao)的(de)上升/下降時(shi)間,一(yi)般認為如果信號(hao)的(de)上升/下降時(shi)間(按(an)10%~90%計)小(xiao)于6倍導線延(yan)時(shi),就是(shi)高速信號(hao),必須注意阻抗匹配的(de)問題。導線延(yan)時(shi)一(yi)般取值為150ps/inch。

  信號(hao)(hao)(hao)沿傳(chuan)(chuan)輸(shu)(shu)線(xian)(xian)(xian)(xian)(xian)傳(chuan)(chuan)播(bo)過程當中,如果傳(chuan)(chuan)輸(shu)(shu)線(xian)(xian)(xian)(xian)(xian)上(shang)(shang)各處具有一致(zhi)的(de)信號(hao)(hao)(hao)傳(chuan)(chuan)播(bo)速度(du),并(bing)且(qie)單位長度(du)上(shang)(shang)的(de)電容也一樣,那么信號(hao)(hao)(hao)在(zai)傳(chuan)(chuan)播(bo)過程中總是(shi)(shi)看到完(wan)全一致(zhi)的(de)瞬(shun)間(jian)阻(zu)抗。由于在(zai)整個傳(chuan)(chuan)輸(shu)(shu)線(xian)(xian)(xian)(xian)(xian)上(shang)(shang)阻(zu)抗維持恒定(ding)不變(bian),我們給(gei)出一個特(te)(te)定(ding)的(de)名稱,來表示特(te)(te)定(ding)的(de)傳(chuan)(chuan)輸(shu)(shu)線(xian)(xian)(xian)(xian)(xian)的(de)這種特(te)(te)征或者是(shi)(shi)特(te)(te)性,稱之為(wei)該(gai)傳(chuan)(chuan)輸(shu)(shu)線(xian)(xian)(xian)(xian)(xian)的(de)特(te)(te)征阻(zu)抗。

  特征阻(zu)抗是(shi)指(zhi)信號沿傳(chuan)輸線(xian)傳(chuan)播時(shi),信號看到的瞬間(jian)阻(zu)抗的值。特征阻(zu)抗與(yu)PCB導線(xian)所在(zai)的板層、PCB所用(yong)的材質(介(jie)電常數)、走(zou)線(xian)寬(kuan)度(du)、導線(xian)與(yu)平面的距離等(deng)因素有關(guan),與(yu)走(zou)線(xian)長(chang)度(du)無關(guan)。特征阻(zu)抗可以使用(yong)軟件(jian)計(ji)算(suan)。高速PCB布線(xian)中,一般(ban)(ban)把數字(zi)(zi)信號的走(zou)線(xian)阻(zu)抗設計(ji)為50歐(ou)姆,這是(shi)個大約的數字(zi)(zi)。一般(ban)(ban)規定同軸(zhou)電纜(lan)基帶(dai)50歐(ou)姆,頻帶(dai)75歐(ou)姆,對絞線(xian)(差分)為100歐(ou)姆。

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